ports/sysdeps/standalone/i960/nindy960/brdinit.c

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   5
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  10
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  15
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  19    02111-1307 USA.  */
  20
  21 #include <standalone.h>
  22 #include "i960ca.h"
  23
  24 /*  _Board_Initialize()
  25
  26 This routine initializes the board.
  27
  28 NOTE: Only tested on a Cyclone CVME961 but should be OK on any i960ca board. */
  29
  30 void
  31 _Board_Initialize ()
  32 {
  33   struct i80960ca_prcb   *prcb;     /* ptr to processor control block */
  34   struct i80960ca_ctltbl *ctl_tbl;  /* ptr to control table */
  35
  36   static inline struct i80960ca_prcb *get_prcb()
  37   { register struct i80960ca_prcb *_prcb = 0;
  38     asm volatile( "calls 5; \
  39                    mov   g0,%0" \
  40                    : "=d" (_prcb) \
  41                    : "0" (_prcb) );
  42     return ( _prcb );
  43   }
  44
  45   prcb    = get_prcb ();
  46   ctl_tbl = prcb->control_tbl;
  47
  48   /*   The following configures the data breakpoint (which must be set
  49    *   before this is executed) to break on writes only.
  50    */
  51
  52   ctl_tbl->bpcon &= ~0x00cc0000;
  53   reload_ctl_group (6);
  54
  55    /*  bit 31 of the Register Cache Control can be set to
  56     *  enable an alternative caching algorithm.  It does
  57     *  not appear to help our applications.
  58     */
  59
  60    /* Configure Number of Register Caches */
  61
  62   prcb->reg_cache_cfg = 8;
  63   soft_reset (prcb);
  64 }